下一代FPGA發布,晶片設計時間大幅減少!

2020-12-14 電子工程專輯

下一代FPGA已經發布,體積明顯變大。英特爾即將推出其Stratix 10 GX 10M FPGA,賽靈思已經宣布將於明年秋季正式推出其VU19P FPGA。預計前者將支持約80M ASIC門,而後者將支持約50M ASIC門。為了儘快將這種門容量引入原型實驗室,S2C與英特爾合作,推出了新的10M Logic System原型平臺,並將在今年年底之前交付首批系統。


使用英特爾新型80M Gate FPGA和S2C進行原型設計


較大的FPGA至少有以下優點:


  • 單個FPGA提供更多可用的ASIC門;

  • 更高的原型性能;

  • 原型製作速度更快。



更多可用的ASIC門


對於那些想從單個FPGA獲得更多可用門的人來說,10M邏輯系統是一個可以立即部署的FPGA原型解決方案。在未來幾年中,視頻處理等領域將需要越來越多的ASIC門。集成了視頻模塊的SoC已經超過了上一代FPGA的門容量,並且設計人員正在極力跟上當今的視頻功能需求。S2C的10M邏輯系統為現在的視頻應用帶來了每個FPGA可用門容量的兩倍以上,並將於明年年初推出雙路和四路FPGA版本支持門容量的持續增長。



更高的原型性能


這些新的,更大的FPGA的另一個優勢是性能。S10 GX 10M晶片核心性能額定為900MHz,LVDS I / O和單向I / O分別額定為1.4GHz和250MHz。實際的原型性能會因應用而異,但在所有其他條件相同的情況下進行比較,這些新型14nm FPGA的原型性能將更高。


組織原型設計層次結構時,在一個FPGA中包含高性能塊或信號肯定會帶來更高的原型性能。藉助S2C的新型10M邏輯系統,單個FPGA中可以包含多達8000萬門的設計模塊;雙路和四路FPGA邏輯系統將在FPGA之間包括高速互連。


S10 10M邏輯系統支持六個板載可編程時鐘(最高350MHz),五個外部時鐘和一個振蕩器插槽。兩個專用的可編程時鐘也提供了車載DDR4存儲器,可以通過一個車載按鈕,一個外部來源的復位通過連接器,或在PlayerPro運行時軟體控制。


更快的原型開發


成功進行原型開發的關鍵之一是最大程度地縮短原型開發時間,並且,快速原型開發必須考慮以下事項:



在FPGA原型平臺上以目標速度運行設計應包括為實現FPGA而精心設計的netlist,同時儘可能保持與仿真netlist的相關性。擁有任何具有原型設計經驗的原型團隊成員將極大地縮短原型開發時間,尤其是在FPGA實現設計時鐘和門控時鐘、嵌入式存儲器和SoC IP方面。


由於仿真netlist是用於矽流片的驗證「黃金標準」,因此應將FPGA原型設計視為提高驗證覆蓋率的一種方法,其範圍超出軟體仿真的能力。因此,在整個驗證過程中保持兩個netlist之間的相關性對於總體驗證效率至關重要。如果在驗證FPGA原型中的設計時出了點問題,就可以通過仿真netlist快速診斷問題的原因,這就是使FPGA原型設計成為如此強大的驗證工具的原因。而且,建立並實施嚴格的bug跟蹤和netlist修正規程對於原型生產力的重要性,必須嚴格強調保持模擬團隊與原型團隊的同步。


使用S2C的10M邏輯系統進行FPGA原型調試的一種方法是使用S2C的Multi-Debug-Module,即「 MDM」。MDM的設置和運行控制項已集成到S2C的PlayerPro軟體中,旨在與10M邏輯系統硬體配合使用,並允許在單個窗口中查看來自多個FPGA的測試數據。MDM最多可提供32K probe,無需重新編譯。可以高達80MHz的速度捕獲跟蹤數據,並且MDM的外部硬體中最多可以存儲8GB的波形數據。


S2C Multi-Debug-Module



為了幫助縮短原型開發時間,S2C提供了與10M邏輯系統一起使用的ProtoBridge。ProtoBridge使用原型硬體和主機之間的PCIe或AXI高吞吐量鏈路,將大量事務級別的測試數據傳輸給設計。測試數據寬度可以從32位到1024位不等,數據速率高達1GB每秒。


S2C ProtoBridge



原文連結:

https://semiwiki.com/semiconductor-manufacturers/intel/279948-webinar-prototyping-with-intels-new-80m-gate-fpga/


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