如何處理PCB設計過程中共阻抗及抑制問題?

2020-12-23 電子發燒友

如何處理PCB設計過程中共阻抗及抑制問題？

李建兵 發表於 2018-03-16 16:46:20

共阻幹擾是由PCB上大量的地線造成。當兩個或兩個以上的迴路共用一段地線時，不同的迴路電流在共用地線上產生一定壓降，此壓降經放大就會影響電路性能;當電流頻率很高時，會產生很大的感抗而使電路受到幹擾。 

為了抑制共阻抗幹擾，可採用如下措施：

(1)一點接地 

使同級單元電路的幾個接地點儘量集中，以避免其他迴路的交流信號竄人本級，或本級中的交流信號竄到其他迴路中去。適用於信號的工作頻率小於1MHZ的低頻電路，如果工作頻率在1一1OMHz而採用一點接地時，其地線長度應不超過波長的1/20.總之，一點接地是消除地線共阻抗幹擾的基本原則。 

(2)就近多點接地

PCB上有大量公共地線分布在板的邊緣，且呈現半封閉迴路(防磁場幹擾)，各級電路採取就近接地，以防地線太長。適用於信號的工作頻率大於lOMHz的高頻電路。 

(3)匯流排接地 

匯流排是由銅箔板鍍銀而成，PCB上所有集成電路的地線都接到匯流排上。匯流排具有條形對稱傳輸線的低阻抗特性，在高速電路裡，可提高信號傳輸速度，減少幹擾。 

(4)大面積接地 

在高頻電路中將PCB上所有不用面積均布設為地線，以減少地線中的感抗，從而削弱在地線上產生的高頻信號，並對電場幹擾起到屏蔽作用。 

(5)加粗接地線

若接地線很細，接地電位則隨電流的變化而變化，致使電子設備的定時信號電平不穩，抗噪聲性能變壞，其寬度至少應大於3mm。

(6)D/A(數/模)電路的地線分開 

兩種電路的地線各自獨立，然後分別與電源端地線相連，以抑制它們相互幹擾。

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